将一整块oo处理器,按功能区拆分成数份。
比如oo上六千个晶体管,们做到那高集成密度,就给拆分成单个三百枚晶体管十份。oo上七个八位寄存器,们就给拆分成七份。
另外把输入、输出端口等等模块也全都“拆”出,变成一个个独立集成电路。
如果曲卓想完成考验,只要按照个思路进行就可以了。但他想做更好。
oo用了六千枚晶体管,达到了每秒万次算力。其实并他位地址总线,和八位数据总线架构极限。
而因特尔现技术,基于单片晶圆利用率,最价比选择。
既然们把一片芯片拆成无数份了,什进一步压榨个平台潜力呢?
什一定要用十片集成了三百枚晶体管芯片,凑够六千数量呢?
什能九千,甚至一万?
六微米工艺们造出,十微米良品率太低。但十微米,甚至十六微米,们工艺成熟度和良品率非常错嘛。
七个寄存器够,加呗,十个够够?
单个位数据总线吞吐量限,再上一条呗。
解决两条数据总线时钟排序问题,对下国内技术员说个巨大难关。
但对曲卓说,好像并什太难事。
就双通道技术变种嘛,设计一款逻辑芯片进行协处理就能解决。
,什要用电路把拆分出芯片焊死呢?
什设计一个标准接口,再搞个支持接平台呢?
就像电脑主板上内存槽,使用者可以据自己实际况,决定多少条内存。
设计一个通用平台很难?
从头设计肯定难,但ib八十年代推出o总线就很合适嘛。能支持到十六位数据带宽,未很多年里都可以一直用着。
思路确定,又脑子里那个高效到令指“东西”辅助,曲卓“呆坐”到凌晨三点多,就完成了所软件设计。
周天,用考虑上班问题。
索爬起开始画图,到了上午十一点多,将所十六种拆分芯片和两种独立设计芯片全部落实到纸面上。
去严家吃了口午饭,又用了两个多小时,将基于o总线构建搭载平台也落实到纸面上。
本想睡一会儿,可很亢奋,本闭上。又爬起给自己设计两款芯片写执行代码。
知觉间,时间就到了下午四点多。
代码写了大半,曲卓忽然脑袋一沉,感觉天旋地转,紧接着前一黑,好像从高空急下坠。
意识迅模糊,身体从椅子上软塌塌滑到地上……
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